Informacja

Drogi użytkowniku, aplikacja do prawidłowego działania wymaga obsługi JavaScript. Proszę włącz obsługę JavaScript w Twojej przeglądarce.

English (EN)·Polski (PL)·Yкраїнський (UK)
Przejdź do strony domowej biblioteki Centralna Biblioteka Wojskowa Link otwiera się w nowym oknie Logo biblioteki Prolib Integro - strona głównaCentralna Biblioteka Wojskowa

Wyszukujesz frazę "Szplet, R." wg kryterium: Wszystkie pola

  Lista filtrów
Wyrównaj
    Wyświetlanie 1-28 z 28
    Tytuł:
    Synchronizacja sygnałów w interpolacyjnych licznikach czasu
    Signals synchronization in interpolating time counters
    Autorzy:
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/209566.pdf
    Data publikacji:
    2008
    Wydawca:
    Wojskowa Akademia Techniczna im. Jarosława Dąbrowskiego
    Tematy:
    metrologia czasu
    interpolacyjny licznik czasu
    układy synchronizacji
    efekt metastabilności
    time metrology
    interpolating time counter
    synchronizing circuit
    metastability effect
    Opis:
    W artykule opisano wyniki analizy synchronizacji sygnałów, realizowanej w precyzyjnych licznikach czasu. W szczególności analiza dotyczy licznika czasu z interpolacją dwustopniową, czterofazowym zegarem o częstotliwości 250 MHz w pierwszym stopniu interpolacji, zrealizowanego w układzie programowalnym FPGA. Analizie poddano trzy układy synchronizacji stosowane w pierwszym stopniu interpolacji dwustopniowych konwerterów czasowo-cyfrowych oraz pięć synchronizatorów licznika okresów. Jako główne kryteria oceny układów użyto maksymalną częstotliwość działania, średni czas między błędami oraz łatwość wykonania w układzie programowalnym.
    This paper presents the results of an analysis of synchronization issues in precise time counters. Particularly the analysis concerns a time counter with two-stage interpolation, four-phase clock of 250-MHz frequency in the first interpolation stage, implemented in an FPGA device. Three synchronizing circuits used in the first interpolation stage of two-stage time-to-digital converters and five synchronizers of enabling signal for period counter are analyzed. For the evaluation of the circuits quality following criteria were applied: the maximum frequency of operation, the mean time between failure and easiness of implementation in a programmable device.
    Źródło:
    Biuletyn Wojskowej Akademii Technicznej; 2008, 57, 4; 287-308
    1234-5865
    Pojawia się w:
    Biuletyn Wojskowej Akademii Technicznej
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    A programmable delay line
    Autorzy:
    Perko, K.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114438.pdf
    Data publikacji:
    2015
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    delay line
    dual interpolation method
    Opis:
    The paper describes the design and test results of a programmable digital delay line implemented in an FPGA device (Kintex-7, Xilinx). The operation of the delay line is based on the modified dual interpolation Nutt method that combines two actions, i.e.: (1) counting the periods of a reference clock and (2) time interpolating within a single clock period. The first action provides an extremely wide range of the introduced delays (> 9 minutes), while the second one allows reaching relatively high delay resolution (2 ns) with a timing jitter as low as 35 ps (until delay of 1 μs). The high metrological parameters of the designed delay line are achieved at the expense of increased difficulty in implementation of the method in an integrated circuit. The major problems to be solved were the synchronizations of input signals as well as synchronous and asynchronous parts of the system, which were effectively provided with the use of two dual-edge synchronizers, a clock signal logic level detection system and associated synchronizers.
    Źródło:
    Measurement Automation Monitoring; 2015, 61, 7; 311-313
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Direct Digital Synthesizer based on Field Programmable Gate Array
    Autorzy:
    Gasik, K.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114565.pdf
    Data publikacji:
    2017
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    direct digital synthesizer
    programmable devices
    FPGA
    Opis:
    We present the principle (Chapter 2), implementation (Chapter 3) and test results (Chapter 4) of direct digital synthesizer (DDS) that most modules, i.e. phase accumulator, ROM memory and optional amplitude control module are implemented in a digital Field Programmable Gate Array (FPGA) device. To obtain smooth shape of analog output signals the FPGA device is followed by a digital-to-analog converter (DAC) and low-pass filter (LPF). The developed DDS allows for generating signals with frequency up to 50 MHz and amplitude up to 1 Vpp. The frequency adjustment resolution is 1.9 kHz, while the amplitude adjustment step equals 61.04 µV. The use of programmable device allows for changing the size of tuning words to adapt the DDS parameters to requirements of particular application.
    Źródło:
    Measurement Automation Monitoring; 2017, 63, 6; 220-222
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Time interval measurement module implemented in SoC FPGA device
    Autorzy:
    Grzęda, G.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/226962.pdf
    Data publikacji:
    2016
    Wydawca:
    Polska Akademia Nauk. Czytelnia Czasopism PAN
    Tematy:
    time interval measurement
    time-to-digital converter
    system on chip
    measurement data processing
    Opis:
    We presents the design and test results of a picosecond-precision time interval measurement module, integrated as a System-on-Chip in an FPGA device. Implementing a complete measurement instrument of a high precision in one chip with the processing unit gives an opportunity to cut down the size of the final product and to lower its cost. Such approach challenges the constructor with several design issues, like reduction of voltage noise, propagating through power lines common for the instrument and processing unit, or establishing buses efficient enough to transport mass measurement data. The general concept of the system, design hierarchy, detailed hardware and software solutions are presented in this article. Also, system test results are depicted with comparison to traditional ways of building a measurement instrument.
    Źródło:
    International Journal of Electronics and Telecommunications; 2016, 62, 3; 237-246
    2300-1933
    Pojawia się w:
    International Journal of Electronics and Telecommunications
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Scalony licznik czasu z użyciem stempli czasowych
    An integrated time counter based on time stamps
    Autorzy:
    Szplet, R.
    Perko, K.
    Powiązania:
    https://bibliotekanauki.pl/articles/155597.pdf
    Data publikacji:
    2013
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    licznik czasu
    metoda stempli czasowych
    układy programowalne
    time counter
    time stamps method
    programmable devices
    Opis:
    W artykule opisane są projekt oraz wyniki badań czterokanałowego licznika czasu zrealizowanego w układzie programowalnym Spartan-6 firmy Xilinx. W liczniku zastosowana została metoda stempli czasowych, w której w wyniku pomiaru uzyskuje się informację o chwilach czasowych pojawienia się impulsów wejściowych na wspólnej skali czasu. Zastosowanie zegara o częstotliwości 500 MHz umożliwiło uzyskanie względnie wysokiej rozdzielczości (2 ns) i precyzji pomiarowej licznika (poniżej 1 ns).
    This paper describes the design and test results of a four-channel time interval counter implemented in a programmable device Spartan-6 (Xilinx). The time stamps method has been applied (Fig. 1). In this method the measurement result delivers no information about the absolute value of the time interval between two input pulses, but carries information about the time moments of appearance of these pulses on a common time scale. This method, contrary to the conventional "start-stop" method, does not require resetting the time counter after each measurement. It eliminates the dead time and enables continuous measurements if a fast enough digital integrated circuit is used. Moreover, a multichannel time counter can be built without necessity to reproduce all blocks of a single-channel counter. It results in savings of the programmable logic resources. The main dis advantage of this method appears in difficulties of implementation. The most important seems to be a synchronization problem (Fig. 4), especially due to use of a high frequency clock signal (500 MHz). The use of such a clock makes it possible to obtain a relatively high resolution (2 ns without interpolation) and precision (less than 1 ns) of the counter. Flexibility of the method allows increasing the resolution and accuracy by using interpolation measurement channels.
    Źródło:
    Pomiary Automatyka Kontrola; 2013, R. 59, nr 8, 8; 839-841
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Estimation of quantization steps of time interpolator in view of temperature changes
    Autorzy:
    Sondej, D.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114194.pdf
    Data publikacji:
    2017
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    time-digital conversion
    two-stage interpolation
    multi-edge coding in independent coding lines
    time counter
    time digitizer
    Opis:
    This paper presents a method of limiting the effect of ambient temperature drift on the measurement uncertainty of a time counter (TC). A change in ambient temperature causes a change in the TC transfer function, i.e. the widths of quantization steps to be exact. Recalibration is a procedure that is then required, but it disturbs the measurement process. However, with the knowledge of the current ambient temperature and having the set of transfer functions identified at different temperatures, it is possible to determine and use the most adequate transfer function and virtually eliminate the temperature impact. For this purpose, three interpolation methods were studied: the nearest neighbor method, linear and polynomial interpolations. A newly evaluated transfer functions were tested in interpolating TC to select the best interpolation method.
    Źródło:
    Measurement Automation Monitoring; 2017, 63, 5; 192-194
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Precyzyjny konwerter czasowo-cyfrowy wykorzystujący metodę skracania impulsu zrealizowany w układzie FPGA
    Precise time-to-digital converter based on pulse-shrinking implemented in FPGA device
    Autorzy:
    Szplet, R.
    Klepacki, K.
    Powiązania:
    https://bibliotekanauki.pl/articles/155687.pdf
    Data publikacji:
    2007
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    precyzyjna metrologia czasu
    konwerter czas-liczba
    skracanie impulsu
    precise time metrology
    time-to-digital converter
    pulse-shrinking
    Opis:
    W artykule przedstawione są projekt i wyniki badań konwertera czas-liczba o rozdzielczości 75 ps i zakresie pomiarowym 5.5 ns. Konwerter został zrealizowany w układzie programowalnym Spartan3 firmy Xilinx. Do konwersji czasowo-cyfrowej zastosowano metodę skracania impulsu. W konwerterze wykorzystano cyfrowy detektor zboczy impulsu, który umożliwia kontrolowanie wartości rozdzielczości i uniezależnia mierzony czas trwania impulsu od niekorzystnego wpływu linii transmisyjnych i programowalnych matryc połączeniowych.
    This paper describes design and test results of the time-to-digital converter with 75 ps resolution and 5.5 ns measurement range. The converter is implemented in a single programmable device from family Spartan3 (Xilinx). The pulse-shrinking method is used for time-to-digital conversion. Digital pulse-edges detector is applied to control of the conversion resolution and to do measured width time of pulse independent from disadvantageous influence of transmission lines and programmable switch matrixes.
    Źródło:
    Pomiary Automatyka Kontrola; 2007, R. 53, nr 7, 7; 21-23
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Scalony konwerter czas-liczba z użyciem metody licznikowej i zegara wielofazowego
    Integrated time-to-digital converter with the use of the counter method and a multiphase clock
    Autorzy:
    Szplet, R.
    Gołaszewski, M.
    Powiązania:
    https://bibliotekanauki.pl/articles/156312.pdf
    Data publikacji:
    2008
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    precyzyjna metrologia czasu
    konwerter czas-liczba
    metoda licznikowa
    zegar wielofazowy
    układy FPGA
    precise time metrology
    time-to-digital converter
    counter method
    multiphase clock
    FPGA devices
    Opis:
    W artykule przedstawione są projekt i wyniki badań konwertera czas-liczba o rozdzielczości 78 ps i niepewności pomiarowej poniżej 100 ps. Pomiar czasu realizowany jest z użyciem 32 liczników zliczających okresy szesnastofazowego zegara o częstotliwości 400 MHz. Ponieważ aktywne są obydwa zbocza zegara jest on równoważny pojedynczemu sygnałowi zegarowemu o częstotliwości 12.8 GHz, co umożliwia osiągnięcie średniej rozdzielczości ok. 78 ps przy interpolacji jednostopniowej. Budowa opisanego konwertera czasliczba pozwala na łatwe rozszerzanie zakresu pomiarowego, wynoszącego 164 žs, poprzez zwiększanie pojemności użytych liczników dwójkowych. Sterowanie procesem pomiarowym oraz wyznaczanie i przetwarzanie wyników pomiarów odbywa się z użyciem dwóch procesorów programowych NIOS II zintegrowanych z konwerterem w układzie programowalnym Stratix II firmy Altera.
    This paper describes design and test results of the time-to-digital converter with 78 ps resolution and accuracy below 100 ps. The time interval measurement is performed with the use of 32 binary counters counting periods of 16-phase clock of the 400 MHz frequency. Since both edges of the clock are active it is an equivalent of a single clock signal of 12.8 GHz frequency, which provides a mean resolution of about 78 ps in a single interpolation stage. The structure of the converter allows to extend its measurement range (164 žs) easily by increasing the capacity of used binary counters. The measurement as well as calculation and processing of obtained results are controlled by two soft-core processors NIOS II implemented together with the converter in a single programmable device from family Stratix II (Altera).
    Źródło:
    Pomiary Automatyka Kontrola; 2008, R. 54, nr 8, 8; 591-593
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    A hardware/software development environment for SoC-based time interval counters
    Autorzy:
    Grzęda, G.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114349.pdf
    Data publikacji:
    2015
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    system on chip
    precise time counter
    AXI Stream protocol
    Opis:
    The paper describes a design environment for development of precise time counters. The design was implemented in a System-on-Chip Zynq from Xilinx as an embedded solution with a custom user interface. The paper presents the system design, a dedicated time counter interface, and software running on the processing part of the Zynq device. It also contains the results of all system performance tests. The tests reveal the design advantages over the traditional approach, involving an FPGA device connected to a PC that serves as a host with a dedicated user interface. The presented development environment allowed reducing the calibration and measurement times twofold and threefold, respectively. Furthermore, thanks to the bus interface designed for data transmission from the time counter to the control module, the 200 MB/s data throughput inside the SoC was achieved.
    Źródło:
    Measurement Automation Monitoring; 2015, 61, 7; 299-301
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    A study of the effect of temperature changes on the interpolating time counter
    Autorzy:
    Sondej, D.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114363.pdf
    Data publikacji:
    2015
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    time interval measurement
    time-to-digital conversion
    two-stage interpolation
    time counter
    Opis:
    This paper presents an analysis of the impact of ambient temperature changes on main parameters of the interpolating time counter. The performed tests reveal that a relatively small change in the ambient temperature of 1°C causes a measurement error of the counter as large as 3.5 ps. The thorough research of two stages of interpolation of the counter allowed determining the main sources of the error. One of them is the temperature drift of widths of four-phase clock (FPC) segments in the first interpolation stage (FIS). It equals 2.5 ps/°C. The widths of FPC phases directly influence the active range of the second interpolation stage (SIS) and its offset. The test results also show that the temperature drift of the offset has a greater impact on the measurement accuracy than the temperature-driven changes of quantization steps in SIS. The presented conclusions are the first step to develop a new method for reducing the impact of changes in the ambient temperature on the measurement accuracy of the interpolating time counter.
    Źródło:
    Measurement Automation Monitoring; 2015, 61, 7; 302-304
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Wysokorozdzielczy konwerter czasowo-cyfrowy z próbkowaniem impulsu
    A high resolution time-to-digital converter based on pulse sampling
    Autorzy:
    Szplet, R.
    Jarzyński, S.
    Powiązania:
    https://bibliotekanauki.pl/articles/153993.pdf
    Data publikacji:
    2009
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    precyzyjna metrologia czasu
    konwerter czas-liczba
    metoda próbkowania
    zegar wielofazowy
    układy FPGA
    precise time metrology
    time-to-digital converter
    sampling method
    multiphase clock
    FPGA devices
    Opis:
    W artykule opisane są projekt i wyniki badań konwertera czasowo-cyfrowego o rozdzielczości 9 ps i niepewności pomiarowej nie przekraczającej 31 ps. Konwerter został zrealizowany w układzie programowalnym Cyclone firmy Altera. Do konwersji czasowo-cyfrowej użyto nowatorskiej metody, w której informacja o mierzonym odcinku czasu zawarta jest w szerokości impulsu, propagującego się wielokrotnie w zamkniętej pętli opóźniającej i próbkowanego z użyciem wielofazowego zegara o wysokiej częstotliwości. Sterowanie procesem pomiarowym oraz obliczanie i przetwarzanie wyników pomiarów odbywa się z wykorzystaniem dedykowanego interfejsu użytkownika opracowanego w języku C++.W artykule opisane są projekt i wyniki badań konwertera czasowo-cyfrowego o rozdzielczości 9 ps i niepewności pomiarowej nie przekraczającej 31 ps. Konwerter został zrealizowany w układzie programowalnym Cyclone firmy Altera. Do konwersji czasowo-cyfrowej użyto nowatorskiej metody, w której informacja o mierzonym odcinku czasu zawarta jest w szerokości impulsu, propagującego się wielokrotnie w zamkniętej pętli opóźniającej i próbkowanego z użyciem wielofazowego zegara o wysokiej częstotliwości. Sterowanie procesem pomiarowym oraz obliczanie i przetwarzanie wyników pomiarów odbywa się z wykorzystaniem dedykowanego interfejsu użytkownika opracowanego w języku C++.
    The paper describes the design and test results of a time-to-digital converter with 9 ps resolution and measurement uncertainty below 31 ps. The converter has been implemented in a programmable device Cyclone manufactured by Altera. The time-to-digital conversion is based on sampling of a periodic square signal. Information about the measured time interval is contained in the width of a pulse that circulates in a closed delay loop and is sampled with the use of a high frequency clock. This method is innovative in the kind of application and it has not been implemented in an integrated circuit so far. In order to achieve both high resolution and high measurement uncertainty the four-phase sampling clock has been used. Such solution allows for fourfold reduction in a number of cycles in the loop and consequently to diminish the measurement error significantly. The four-phase clock has been generated with an embedded PLL functional block. An issue of fundamental importance for the successful implementation of the converter was the use of two short pulses as a representation of the begin and the end of a measured time interval instead of a single long-width pulse. In this way an unpredictable shrinking or stretching of a measured time interval by elements of the delay loop that have different propagation times for rising and falling edges has been avoided. The measurement as well as calculation and processing of obtained results are controlled with the use of dedicated user interface worked out in C++.
    Źródło:
    Pomiary Automatyka Kontrola; 2009, R. 55, nr 8, 8; 642-644
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Precyzyjny przetwornik czas-liczba z powielaniem i uśrednianiem czasu trwania impulsu
    A high precision time-to-digital converter based on pulse repetition and time width averaging
    Autorzy:
    Szplet, R.
    Poteralski, M.
    Powiązania:
    https://bibliotekanauki.pl/articles/156641.pdf
    Data publikacji:
    2012
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    precyzyjna metrologia czasu
    przetwornik czas-liczba
    metoda uśredniania
    układy FPGA
    precise time metrology
    time-to-digital converter
    averaging method
    FPGA devices
    Opis:
    This paper describes the design and test results of a time-to-digital converter with 1.9 ps resolution and measurement uncertainty below 12.2 ps (Fig. 4). The time-to-digital conversion is based on time width averaging. Information about the measured time interval is contained in the width of a pulse that circulates in a closed delay loop and its width is measured by the counting method with use of a high frequency multiphase clock (Fig. 1). The converter resolution is directly proportional to the number of cycles of the measured pulse in the delay loop, the number of phases and frequency of a clock used (2). However, increase in the number of loop cycles causes growth in the jitter of circulating pulse edges that finally leads to deterioration in the measurement precision. Therefore, in order to obtain the highest precision of conversion, the number of cycles for which the converter provides the smallest measurement uncertainty was experimentally determined. In addition, to minimize a disadvantageous impact of unequal propagation times of the loop elements for the rising and falling pulse edges on the value of the measured time interval, the information about the measured time interval is contained between the rising edges of the pulse-pair instead of the opposite (rising and falling) edges of a single pulse (Fig. 2). The converter was implemented in a programmable device Spartan-6 manufactured by Xilinx. (Xilinx).
    Źródło:
    Pomiary Automatyka Kontrola; 2012, R. 58, nr 7, 7; 569-571
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Pseudo-random bit generators based on linear-feedback shift registers in a programmable device
    Autorzy:
    Parol, M.
    Dąbal, P.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114462.pdf
    Data publikacji:
    2016
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    pseudo-random bit generators
    linear-feedback shift register
    programmable device
    Opis:
    We present the results of comparative study on three pseudo-random bit generators (PRBG) based on various use of linear-feedback shift registers (LFSR). The project was focused on implementation and tests of three such PRBG in programmable device Spartan 6, Xilinx. Tests of the designed PRBGs were performed with the use of standard statistical tests NIST SP800-22.
    Źródło:
    Measurement Automation Monitoring; 2016, 62, 6; 184-186
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Digital-to-Time Converter for pulse train generation based on Look-Up Tables in FPGA
    Autorzy:
    Kwiatkowski, P.
    Różyc, K.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114335.pdf
    Data publikacji:
    2018
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    Digital-to-Time Converter
    time interval generator
    programmable delay line
    programmable devices
    Opis:
    A Digital-to-Time Converter (DTC) is presented which allows to generate pulse train with resolution of 250 ps within 32 ns operation range. The converter is implemented in off-the-shelf Spartan-6 Field-Programmable Gate Array (FPGA) device, manufactured by Xilinx in 45 nm CMOS technology. The design is implemented with the use of Look-Up Tables (LUT) as delay elements. “Manual” Place and Route (P&R) process was involved to improve conversion linearity. Developed DTC can be used to improve the functionality of time interval generators.
    Źródło:
    Measurement Automation Monitoring; 2018, 64, 1; 14-16
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Bezpośredni przetwornik czas-liczba z kodowaniem wielokrotnym
    A direct time-to-digital converter with multiple coding
    Autorzy:
    Szplet, R.
    Sondej, D.
    Grzęda, G.
    Powiązania:
    https://bibliotekanauki.pl/articles/151174.pdf
    Data publikacji:
    2013
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    precyzyjna metrologia czasu
    przetwornik czas-liczba
    metoda kodowania wielokrotnego
    układy FPGA
    precise time metrology
    time-to-digital converter
    wave union method
    FPGA devices
    Opis:
    W artykule opisane są projekt i wyniki badań przetwornika czas-liczba o rozdzielczości 5,3 ps (1 LSB) i zakresie pomiarowym 428 ps. Do przetwarzania czasowo-cyfrowego użyta została metoda kodowania wielokrotnego. Metoda ta umożliwia pokonanie ograniczeń technologicznych współczesnych układów scalonych i uzyskanie wartości rozdzielczości mniejszej niż czas propagacji pojedynczej komórki linii kodującej. Przetwornik został zrealizowany w układzie programowalnym Spartan-6 firmy Xilinx.
    This paper presents the implementation and tests results of a time-to-digital converter based on the wave union method and implemented in Spartan-6 FPGA (Xilinx). The converter has the resolution of 5,3 ps (1 LSB) in the measurement range of 428 ps and the integral nonlinearity of 3,8 LSB (Fig. 7). In the wave union method, contrary to the typical conversion methods with a single coding, the resolution is lower than the FPGA cell delay thanks to coding several transitions of the time event signal (Fig. 2). In addition, the linearity of conversion is increased by reducing the width of wide bins. Although, using a multi-transition pattern gives better performance, it also brings more problems to be solved. The main problems such as implementation of a pattern generator for certain amount of transitions, minimal delays between transitions and elimination of bubble errors are discussed in this paper. The pattern generator (Fig. 3) is implemented with use of a carry chain. It enables controlling the pattern by means of diagnostic and measurement software. Bubble errors (Fig. 4) are eliminated with a fast asynchronous encoder (Fig. 5). The diagnostic-control software (Fig. 6) allows to configure the pattern generator, launch the measurement session and generate a text file with all information needed to calculate conversion characteristics of the time-to-digital converter.
    Źródło:
    Pomiary Automatyka Kontrola; 2013, R. 59, nr 8, 8; 842-844
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Evaluation of Selected Timing Parameters of FPGA Device
    Autorzy:
    Sondej, D.
    Szymanowski, R.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114158.pdf
    Data publikacji:
    2018
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    propagation time
    jitter
    ring oscillator
    delay line
    carry chain
    LUT
    FPGA
    Opis:
    We present a method and results of measurements of FPGA (Field Programmable Gate Array) selected timing parameters crucial in many timing sensitive applications such as precise time and frequency metrology. Two main parameters, i.e. the delay and its jitter, were evaluated for look-up-tables (delay 740 ps/jitter 1.33 ps), IO buffers (na/0.45 ps) and carry-chain multiplexers (28ps/0.153 ps) integrated in a programmable device Spartan-6 (Xilinx) which is one of most popular FPGA chips on the market now. Measurements were performed with the use of fast real-time sampling oscilloscope.
    Źródło:
    Measurement Automation Monitoring; 2018, 64, 1; 23-25
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    An autonomous microcontroller system for controlling a multi-channel time counter
    Autorzy:
    Sondej, D.
    Sawicki, M.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114671.pdf
    Data publikacji:
    2015
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    microcontroller
    time counter
    autonomous system
    time-to-digital converter
    Opis:
    The paper presents the design of a microprocessor system intended for control, data processing and communication in a multi-channel time counter. The time counter is a relatively complex autonomous instrument designed for measurements of time with picosecond precision and frequency within a range of 3.5 GHz. The device employs a high-speed, single-chip microcontroller with event-driven programming without the mediation of an operating system. The autonomous operation of the measurement system with real-time controlling and data processing was achieved. The paper focuses on the hardware design and the software development model which enables collision-free and concurrent work of many components. The device uses advanced mechanisms available in STM32 series microcontrollers, allowing the efficient support for USB and Ethernet interfaces. The microprocessor system works at a relatively low frequency, which minimizes emission of interference and allows measuring time intervals with a high precision.
    Źródło:
    Measurement Automation Monitoring; 2015, 61, 7; 305-307
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Identyfikacja parametrów dynamicznych linii szybkich przeniesień oraz globalnych linii zegarowych w układach programowalnych Spartan-6
    Identification of dynamic parameters of fast carry chains and global clock networks in Spartan 6 FPGA devices
    Autorzy:
    Kwiatkowski, P.
    Szymanowski, R.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/155755.pdf
    Data publikacji:
    2013
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    układy programowalne
    przetworniki czasowo-cyfrowe
    linie przeniesień arytmetycznych
    globalne linie zegarowe
    programmable device
    time-to-digital converters
    carry chains
    global clock networks
    Opis:
    W artykule przedstawiono analizę parametrów dynamicznych linii szybkich przeniesień arytmetycznych oraz globalnych linii zegarowych w układzie FPGA Spartan-6 firmy Xilinx. Określono opóźnienia sygnału zegarowego oraz impulsu propagującego się w liniach szybkich przeniesień w oparciu o model czasowy układu. Wyniki symulacji zweryfikowano eksperymentalnie. Ponadto, w artykule określono wpływ warunków otoczenia (temperatury i napięcia zasilania) na opóźnienia w układzie.
    This paper presents the analysis of dynamic parameters of fast carry chains and global clock network in Spartan-6 (Xilinx) FPGA devices. The clock signal distribution and the carry chain structure are described in Section 2 (Fig. 1) and in Section 3 (Fig. 3) [1], respectively. Based on the Spartan 6 timing model [2], propagation delays in 32 time coding lines were examined. A relatively large clock skew was observed on the border of some clock regions (Fig. 2). The look ahead carry propagation was also identified. This helped to improve the resolution of coding lines [3] by eliminating death bins. Thanks to the timing model, two different types of coding lines were identified in two kind of SLICEs (Section 3, SLICEL in Fig. 4a and SLICEM in Fig. 4b). The simulation results were compared with the experimental ones obtained from the statistical code density test [4]. The 3-dimensional maps of bin widths (delays) were created to show actual differences between each of 32 coding lines (Fig. 5). The influence of temperature (Fig. 6) and power supply (Fig. 7) on delays in FPGA were also tested based on the behavior of the time coding lines resolution (Section 4). The similar clock network distribution and carry chain structures are also used in the newest FPGAs from Xilinx (Artix, Kintex, Virtex-7). The presented results can be applied to a broad class of programmable devices.
    Źródło:
    Pomiary Automatyka Kontrola; 2013, R. 59, nr 8, 8; 757-759
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Oprogramowanie diagnostyczno-sterujące interpolacyjnego licznika czasu w układzie programowalnym
    Diagnostic and control software for the interpolating time counter implemented in a programmable device
    Autorzy:
    Grzęda, G.
    Sondej, D.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/155302.pdf
    Data publikacji:
    2014
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    precyzyjna metrologia czasu
    oprogramowanie diagnostyczno-sterujące
    kodowanie wielokrotne w niezależnych liniach kodujących
    model warstwowy
    precise time metrology
    diagnostic-control software
    multiedge coding in independent coding lines
    layer model
    Opis:
    W artykule opisano projekt oprogramowania diagnostyczno-sterującego licznika czasu z kodowaniem wielokrotnym w niezależnych liniach kodujących, wykonanego w układzie programowalnym Spartan-6 firmy Xilinx. Przedstawiono sposób sterowania licznikiem czasu, koncepcję oprogramowania sterującego, jego zadania oraz warstwową budowę. Opisano graficzny interfejs użytkownika programu i jego funkcjonalność. Prezentowane są także wyniki badań eksperymentalnych licznika czasu.
    This paper presents the diagnostic and control software of a time interval counter with multi-edge coding in independent coding lines, implemented in the Spartan-6 FPGA device manufactured by Xilinx. The method of time-to-digital conversion [1] is presented along with the design of the time interval counter (Fig. 1). Subsequently, the main goals of the control software, along with its logical structure, are described. The paper shows the layer model (Fig. 2) of the program, reveals the method of communication with the time counter and the way of decoding measurement frames. The bottom-most communication layer transfers the data through USB to the device. The next control layer operates on hardware registers and the measurement layer calibrates the counter and triggers measurements. Finally, the graphic user interface (GUI) layer binds the application together and steers the user interface. The program operates in two main modes: calibration and time interval measurement. Apart from both these modes, the data flow across the layers and the way of saving data generated during counter operation are described. The GUI (Fig. 3) is described as well, showing the main types of operation along with the capabilities of configuring the calibration and measurement processes. Finally, the paper presents the test results of the time counter in both main operation modes (Fig. 4).
    Źródło:
    Pomiary Automatyka Kontrola; 2014, R. 60, nr 7, 7; 441-443
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Parallel data processing in a 3-channel integrated time-interval counter
    Autorzy:
    Jachna, Z.
    Szplet, R.
    Kwiatkowski, P.
    Różyc, K.
    Powiązania:
    https://bibliotekanauki.pl/articles/114531.pdf
    Data publikacji:
    2015
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    programmable device
    time-to-digital converters
    interpolating time counters
    parallel data processing
    Opis:
    In this paper, we discuss an issue of parallel data processing in multichannel time interval counters (TICs). Particularly we analyze this problem within the framework of a 3-channel TIC developed for the international project Legal Time Distribution System (LTDS). The TIC provides the high measurement precision (< 15 ps) and wide range (> 1s) that are obtained by combining reference clock period counting with in-period interpolation. A measurement process consists of three main stages: (1) events registration, (2) data processing and (3) data transfer. In the event registration stage all input events are identified and registered with related unique timestamps based on a consistent time scale. To achieve high measurement precision, the stream of timestamps is then processed using actual transfer characteristics of the TIC and offset values of all measurement channels. We describe the concept of parallel data processing and its implementation in a Spartan-6 FPGA device (XC6SLX75, Xilinx).
    Źródło:
    Measurement Automation Monitoring; 2015, 61, 7; 308-310
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Procesor kodu do realizacji procedur kalibracyjnych w interpolacyjnym liczniku czasu
    A code processor for realization of calibration procedures in an interpolating time counter
    Autorzy:
    Jachna, Z.
    Szplet, R.
    Kwiatkowski, P.
    Różyc, K.
    Powiązania:
    https://bibliotekanauki.pl/articles/151466.pdf
    Data publikacji:
    2014
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    układy programowalne
    przetworniki czasowo-cyfrowe
    interpolacyjny licznik czasu
    programmable device
    time-to-digital converters
    interpolating
    time counter
    Opis:
    W artykule opisano projekt procesora kodu (PK) stanowiącego fragment dwukanałowego precyzyjnego licznika czasu z niezależnymi interpolatorami dwustopniowymi. Projekt został zrealizowany w układzie programowalnym XC6SLX75 (Xilinx). Zadaniem układów PK jest wykonywanie kalibracji linii kodujących, w wyniku której następuje aktualizowanie charakterystyk przetwarzania i w efekcie zwiększenie precyzji pomiarowej licznika. Dzięki sprzętowej implementacji algorytmów kalibracyjnych uzyskuje się skrócenie czasu wykonywania kalibracji, zmniejszenie liczby danych przesyłanych do komputera oraz zmniejszenie złożoności oprogramowania sterującego.
    In the paper there is presented a design of a code processor (PK) as a part of a 2-channel precise time counter with independent 2-stage interpolators. The project was implemented in Spartan-6 (Xilinx) FPGA device. The main task of the PK is calibration of coding lines, resulting in updating transfer characteristics and, as an effect, higher measurement precision of the counter. Thanks to the hardware implementation of calibration algorithms there are achieved: the shorter execution time of calibration procedures, the lower amount of data transferred into the computer and less complex control software. The first simple realization of the PK has been implemented using Spartan-3 device (Xilinx) [8]. This paper presents a new, improved realization of the PK whose characteristic is more suited for the newest counters and those to be invented in the future. The use of VHDL language for description of the PK makes it more susceptible to be adapted. This paper consists of description of the counter with advanced architecture of interpolators [7] , where 10 independent time coding lines where implemented in each measurement channel. The operating principle of the PK is described based on the following scheme: precise description of code density test realization, the way of forming the transfer characteristic and the results calculations.
    Źródło:
    Pomiary Automatyka Kontrola; 2014, R. 60, nr 7, 7; 438-440
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Scalony licznik czasu z użyciem stempli czasowych i interpolacji dwustopniowej
    An integrated time counter based on timestamps and two-stage interpolation
    Autorzy:
    Kwiatkowski, P.
    Szplet, R.
    Jachna, Z.
    Różyc, K.
    Powiązania:
    https://bibliotekanauki.pl/articles/157252.pdf
    Data publikacji:
    2014
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    układy programowalne
    przetworniki czasowo-cyfrowe
    metoda stempli czasowych
    interpolacja dwustopniowa
    programmable device
    time-to-digital converters
    time stamps method
    two-stage interpolation
    Opis:
    W artykule opisano budowę i działanie licznika czasu opartego na metodzie stempli czasowych i dwustopniowej interpolacji. Licznik został zaimplementowany w układzie programowalnym FPGA Kintex-7 firmy Xilinx. Pokazano sposób tworzenia stempli czasowych o wysokiej rozdzielczości oraz opisano problemy projektowe pojawiające się podczas implementacji projektu w układzie FPGA. Opracowany licznik charakteryzuje się wysoką rozdzielczością (< 11,6 ps) i precyzją (< 12 ps) oraz dużą szybkością powtarzania pomiarów (do 12 milionów pomiarów na sekundę). Słowa kluczowe: układy programowalne, przetworniki czasowo-cyfrowe, metoda stempli czasowych, interpolacja dwustopniowa.
    This paper presents an integrated time counter based on timestamps and two-stage interpolation methods implemented in an FPGA programmable device. The timestamps method [2, 3] is useful, among others, in physical experiments and laser ranging systems [2, 4, 5]. To obtain high (picoseconds) resolution, it can be combined with the Nutt interpolation method [1, 6]. The principle of measurement is described in Section 2 and shown in Fig. 1. The time counter contains a period counter, a period counter register and 8 independent channels (Fig. 2, Section 3). Each channel consists of a multiphase clock generator, first and second interpolation stage modules and a channel register. The principle of operation and the way of implementing them in a Kintex-7 FPGA device (Xilinx) [7] are also presented in Section 3. The time counter was examined in terms of resolution and precision for each measurement channel (Section 4). The resolution was evaluated using the statistical code density test [8] and its value was below 12 ps. In Fig. 3 there is shown the time counter precision. In the range up to 1 ms it does not exceed 12 ps. For longer time intervals the precision is worsened by the limited stability of the reference clock. The maximum measurement rate for a single channel was experimentally estimated as 12 million measurements per second. The presented time counter is characterized by high metrological parameters (due to the interpolation method) and wide functionality (due to the time stamps).
    Źródło:
    Pomiary Automatyka Kontrola; 2014, R. 60, nr 7, 7; 435-437
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Scalony licznik czasu i częstotliwości z użyciem odwrotnościowej metody pomiaru częstotliwości i ulepszonej metody tworzenia histogramu
    Autorzy:
    Szplet, R.
    Jachna, Z.
    Kalisz, J.
    Różyc, K.
    Powiązania:
    https://bibliotekanauki.pl/articles/155685.pdf
    Data publikacji:
    2007
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    precyzyjna metrologia czasu
    pomiar częstotliwości
    korekcja nieliniowości
    precise time metrology
    frequency measurements
    nonlinearity correction
    Opis:
    Opisany jest projekt i wyniki badań precyzyjnego licznika czasu i częstotliwości zrealizowanego w układzie programowalnym FPGA oraz metody pomiaru i przetwarzania danych umożliwiające zwiększenie dokładności. Pomiar odcinka czasu jest realizowany w oparciu o metodę Nutta, a pomiar częstotliwości z użyciem metody odwrotnościowej lub klasycznej metody bramkowej. W celu zwiększenia dokładności wyznaczania histogramu serii pomiarów zastosowano ulepszoną metodę opartą na sumowaniu rozkładów prawdopodobieństw. Opracowany licznik ma rozdzielczość 200 ps i niepewność pomiarową poniżej 150 ps. Układ wykonany został w programowalnej matrycy bramkowej QL16x24B serii pASIC firmy QuickLogic.
    This paper describes design and test results of precise time and frequency counter implemented in a general purpose FPGA device. Methods for frequency measurement and advanced data processing leading to accuracy improvement are also presented. In the designed counter, time intervals are measured with the use of the interpolation Nutt method while for frequency measurements two methods are involved: classical gating and reciprocal method. To increase accuracy of the histogram of measurement results an improved method of calculation is adopted. This method is based on aggregation of probability distributions related to consecutive measurement results and evaluated during the initial calibration process. The described counter featuring 200 ps resolution and 150 ps accuracy was integrated in programmable device QL16x24B from pASIC family (QuickLogic).
    Źródło:
    Pomiary Automatyka Kontrola; 2007, R. 53, nr 7, 7; 18-20
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Precyzyjny licznik czasu i częstotliwości z interfejsem PCI
    Precise time and frequency counter with pci interface
    Autorzy:
    Kalisz, J.
    Jachna, Z.
    Szplet, R.
    Różyc, K.
    Powiązania:
    https://bibliotekanauki.pl/articles/208422.pdf
    Data publikacji:
    2006
    Wydawca:
    Wojskowa Akademia Techniczna im. Jarosława Dąbrowskiego
    Tematy:
    metrologia czasu
    pomiar odcinka czasu
    pomiar częstotliwości
    rozdzielczość pikosekundowa
    interpolator czasu
    przetwornik czas-liczba
    time metrology
    time interval measurement
    frequency measurement
    picosecond resolution
    time interpolator
    time-to-digital converter
    Opis:
    Opisujemy budowę, działanie i wyniki pomiarów testowych precyzyjnego licznika czasu i częstotliwości, zrealizowanego w postaci karty komputerowej z interfejsem PCI. Pomiar odcinka czasu jest realizowany przy użyciu interpolacyjnej metody Nutta i specjalistycznego układu scalonego, wykonanego w technologii CMOS FPGA oraz zawierającego dwa interpolatory czasu. Licznik umożliwia pomiary odcinka czasu z rozdzielczością 200 ps i typowej niepewności pomiarowej ok. 150 ps, oraz pomiary częstotliwości metodą odwrotnościową do 3,5 GHz. Wbudowane są procedury specjalistyczne do kalibracji licznika, korekcji zegara, pomiaru różnicy częstotliwości i dewiacji Allana. Dzięki zastosowaniu szybkiej pamięci buforowej FIFO uzyskano dużą szybkość pomiarów, sięgającą 1.66⋅10⁶ pomiarów na sekundę przy transmisji danych do pamięci FIFO.
    We describe the design, operation and test results of a precise time and frequency counter, built as a computer board with PCI interface. The time interval is measured with the use of the Nutt interpolation method implemented in a CMOS FPGA device containing two proprietary time interpolators. The time interval can be measured with a 200 ps resolution and the measurement uncertainty typically of about 150 ps. The frequency can be measured up to 3.5 GHz using the reciprocal method. Special routines have been built-in for counter calibration, clock correction, measurement of frequency difference, and Allan deviation. Thanks to the use of a fast FIFO memory, a high measurement rate has been achieved, reaching 1.66⋅10⁶ measurements per second when transferring data to FIFO memory.
    Źródło:
    Biuletyn Wojskowej Akademii Technicznej; 2006, 55, sp.; 43-58
    1234-5865
    Pojawia się w:
    Biuletyn Wojskowej Akademii Technicznej
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Zastosowanie interpolacyjnej metody pomiaru odcinka czasu do precyzyjnego pomiaru częstotliwości
    Application of time-interval measurement interpolation method for precise frequency measurement
    Autorzy:
    Jachna, Z.
    Szplet, R.
    Różyc, K.
    Klepacki, K.
    Powiązania:
    https://bibliotekanauki.pl/articles/209142.pdf
    Data publikacji:
    2008
    Wydawca:
    Wojskowa Akademia Techniczna im. Jarosława Dąbrowskiego
    Tematy:
    precyzyjny pomiar odcinka czasu
    konwerter czas-liczba
    odwrotnościowa metoda pomiaru częstotliwości
    przyrządy wirtualne
    precise time-interval measurement
    time-to-digital converter
    reciprocal method for frequency measurement
    virtual instruments
    Opis:
    Przedstawiono problemy projektowe dotyczące implementacji odwrotnościowej metody pomiaru częstotliwości w układzie FPGA. Analizowane są sposoby osiągania wysokiej dokładności przy relatywnie krótkim czasie trwania pomiaru, minimalizacji wartości czasu martwego, maksymalizacji częstotliwości powtarzania pomiarów oraz efektywnym szacowaniu miar statystycznych. Zaprezentowano wyniki badań karty pomiarowej z układem programowalnym Spartan3 (Xilinx), w którym zintegrowane zostały kompletny licznik czasu, pamięć FIFO i układ sterujący.
    This paper describes the design problems concerning implementation of the reciprocal method of a frequency measurement in an FPGA device. The following problems are examined: ways of reaching the high accuracy with a relatively short measurement time, minimization of the dead time, maximization of the frequency of measurement repetition, and effective calculation of statistics. Test results of a computer card for frequency measurement are presented. The card is equipped with the precise time counter integrated together with FIFO memory and a control system in the Spartan3 device (Xilinx).
    Źródło:
    Biuletyn Wojskowej Akademii Technicznej; 2008, 57, 2; 277-288
    1234-5865
    Pojawia się w:
    Biuletyn Wojskowej Akademii Technicznej
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    A multichannel programmable distribution amplifier
    Autorzy:
    Różyc, K.
    Kwiatkowski, P.
    Sawicki, M.
    Jachna, Z.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/114493.pdf
    Data publikacji:
    2015
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    programmable device
    distribution amplifier
    Opis:
    This paper presents the design, operation and test results of a multichannel programmable distribution amplifier. The distributor is based on a reprogrammable device Spartan-6 FPGA (Xilinx) and is intended to distribute a 10 MHz or 5 MHz frequency reference signal as well as 1 PPS pulses. It is built in a 2U, 19” rack-mount enclosure and is equipped with a single optical and seven electrical inputs, as well as two optical and fourteen electrical outputs The transition time and additive jitter of the distribution amplifier were tested and they did not exceed 14 ns and 4.5 ps RMS (for electrical inputs/outputs), respectively. In the case of optical input/outputs, the results depend on the parameters of converters involved. The values of delays and jitter introduced by the distributor are slightly larger than for dedicated integrated circuits, but the advantage of this solution is the possibility to build signal distributors with a larger number of inputs/outputs and the ease to modify and meet requirements of various applications.
    Źródło:
    Measurement Automation Monitoring; 2015, 61, 7; 314-316
    2450-2855
    Pojawia się w:
    Measurement Automation Monitoring
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    5 ps Jitter Programmable Time Interval/Frequency Generator
    Autorzy:
    Kwiatkowski, P.
    Różyc, K.
    Sawicki, M.
    Jachna, Z.
    Szplet, R.
    Powiązania:
    https://bibliotekanauki.pl/articles/221151.pdf
    Data publikacji:
    2017
    Wydawca:
    Polska Akademia Nauk. Czytelnia Czasopism PAN
    Tematy:
    time interval generator
    digital-to-time converter
    DDS synthesizer
    phase shifting
    FPGA
    Opis:
    A new time interval/frequency generator with a jitter below 5 ps is described. The time interval generation mechanism is based on a phase shifting method with the use of a precise DDS synthesizer. The output pulses are produced in a Spartan-6 FPGA device, manufactured by Xilinx in 45 nm CMOS technology. Thorough tests of the phase shifting in a selected synthesizer are performed. The time interval resolution as low as 0.3 ps is achieved. However, the final resolution is limited to 500 ps to maximize precision. The designed device can be used as a source of high precision reference time intervals or a highly stable square wave signal of frequency up to 50 MHz.
    Źródło:
    Metrology and Measurement Systems; 2017, 24, 1; 57-68
    0860-8229
    Pojawia się w:
    Metrology and Measurement Systems
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
    Tytuł:
    Wielokanałowy modułowy licznik czasu z użyciem układów programowalnych
    A modular multi-channel time counter using programmable devices
    Autorzy:
    Różyc, K.
    Szplet, R.
    Kwiatkowski, P.
    Sawicki, M.
    Jachna, Z.
    Powiązania:
    https://bibliotekanauki.pl/articles/158352.pdf
    Data publikacji:
    2014
    Wydawca:
    Stowarzyszenie Inżynierów i Techników Mechaników Polskich
    Tematy:
    układy programowalne
    przetworniki czasowo-cyfrowe
    licznik czasu
    interpolacja dwustopniowa
    time counter
    programmable device
    time-to-digital converter
    two-stage interpolation
    Opis:
    Przedstawiono budowę, zasadę działania i wyniki badań wielokanałowego modułowego licznika czasu. Umożliwia on równoczesny pomiar relacji czasowych pomiędzy impulsami wejściowymi (START), pochodzącymi z maksymalnie sześciu niezależnych źródeł zegarowych, a wspólnym dla wszystkich kanałów impulsem odniesienia (STOP). Moduły pomiarowe licznika wykonano z użyciem układów programowalnych FPGA Spartan-3 (Xilinx). Licznik charakteryzuje się zakresem pomiarowym do 1 s oraz precyzją pomiarów nie gorszą niż 250 ps.
    We present the design, operation and test results of a modular multichannel time counter built with the use of programmable devices. Its resolution is below 50 ps and the measurement range reaches 1 sec. The design of the counter is shown in Fig. 1. It consists of six independent measurement modules. Each measurement module contains a 2-channel time interval counter (Fig. 2) implemented in a general-purpose reprogrammable device Spartan-3 (Xilinx). To obtain both high precision and wide measurement range, the counting of periods of a reference clock is combined with a two-stage interpolation within a single period of the clock signal [6]. The interpolation involves a four-phase clock in the first interpolation stage [8] and a time delay coding line in the second interpolation stage. The reference clock module contains an integrated digital synthesizer [7], that provides the reference clock signal of 250 MHz for measurement modules, and is driven by an external clock source of 5 MHz or 10 MHz. The standard measurement uncertainty of the time counter was tested (Figs. 3 and 4) carefully and it did not exceed 250 ps in the full measurement range. As the acid test of the time counter, the differences between signals of 1 PPS from the tested clock sources and the reference 1 PPS signal were also verified (Figs. 5 and 6). The modular design makes the multi-channel time counter easy to modify to meet requirements of various applications.
    Źródło:
    Pomiary Automatyka Kontrola; 2014, R. 60, nr 7, 7; 432-434
    0032-4140
    Pojawia się w:
    Pomiary Automatyka Kontrola
    Dostawca treści:
    Biblioteka Nauki
    Artykuł
      Wyświetlanie 1-28 z 28

      Ta witryna wykorzystuje pliki cookies do przechowywania informacji na Twoim komputerze. Pliki cookies stosujemy w celu świadczenia usług na najwyższym poziomie, w tym w sposób dostosowany do indywidualnych potrzeb. Korzystanie z witryny bez zmiany ustawień dotyczących cookies oznacza, że będą one zamieszczane w Twoim komputerze. W każdym momencie możesz dokonać zmiany ustawień dotyczących cookies