Informacja

Drogi użytkowniku, aplikacja do prawidłowego działania wymaga obsługi JavaScript. Proszę włącz obsługę JavaScript w Twojej przeglądarce.

Wyszukujesz frazę "sigma delta modulator" wg kryterium: Temat


Wyświetlanie 1-2 z 2
Tytuł:
Analiza własności metrologicznych przetworników A/D zbudowanych na bazie modulatorów sigma-delta różnych rzędów
Metrological analysis of A/D converters with sigma-delta modulators of different orders
Autorzy:
Sidor, T.
Powiązania:
https://bibliotekanauki.pl/articles/156804.pdf
Data publikacji:
2014
Wydawca:
Stowarzyszenie Inżynierów i Techników Mechaników Polskich
Tematy:
modulator sigma-delta
przetwornik A/D
błąd kwantyzacji
A/D converters
sigma-delta modulators
quantization errors
Opis:
W artykule porównano własności metrologiczne przetworników A/D z modulatorami sigma-delta pierwszego i drugiego rzędu stosując analizę w dziedzinie czasu. Wykazano, że przetworniki z modulatorami wyższych rzędów, wykazują w istocie ten sam poziom błędów kwantowania, co przetworniki z modulatorem pierwszego rzędu. Zwrócono również uwagę na istotne niekonsekwencje, pojawiające się w licznych opracowaniach na ten temat, które posługują się analizą w dziedzinie częstotliwości.
In this paper the time domain analysis is used to compare metrological properties of sigma-delta A/D converters with first order modulator and converters with modulators of higher order. Modulators of higher orders are widely advertised for such converters to be used in digital acoustic systems. The paper proves that from the viewpoint of the important metrological property of such converters i.e. the level of quantization error there is no superiority in performance of A/D converters with higher order modulators over converters with modulator of first order. It was confirmed by a simulation experiment, performed using the MICROCAP circuit simulator (Figs. 7 and 8), where the quantization error levels were compared for modulators of first and second order. Moreover, there is pointed out a certain inconsistency present in numerous papers [2, 4, 5] in which the frequency domain analysis is used to explain noise shaping phenomenon. There is no direct digital filtration possible straight at the sigma-delta modulator output and decimation afterwards. In fact both actions are performed by a single counter, which can be described as both, basically decimator and digital filter (Fig.6).
Źródło:
Pomiary Automatyka Kontrola; 2014, R. 60, nr 2, 2; 94-97
0032-4140
Pojawia się w:
Pomiary Automatyka Kontrola
Dostawca treści:
Biblioteka Nauki
Artykuł
Tytuł:
Polyphase Comb Filter Based on Dispatching Input Bit-stream and Interlaying Multiplexer Techniques for Sigma-Delta ADCs
Autorzy:
Abdollahvand, S.
Goes, J.
Paulino, N.
Gomes, L.
Powiązania:
https://bibliotekanauki.pl/articles/397961.pdf
Data publikacji:
2012
Wydawca:
Politechnika Łódzka. Wydział Mikroelektroniki i Informatyki
Tematy:
filtr decymacyjny
filtr wielofazowy
modulator sigma-delta
field-programmable gate array
FPGA
decimation filter
Polyphase Comb filter
sigma-delta modulators
field programmable gate array (FPGA)
Opis:
This paper describes a new design approach for implementing a Polyphase Comb Filter (PCF) based on dispatching input bit-stream and interlaying multiplexer techniques. In order to make our solution more energy efficient in comparison with prior art, we start with a detailed analysis of the drawbacks and advantages of the existing classical techniques. A new structure based on a novel SINC3 design is proposed. This new design uses a controller unit to activate one sub-filter in each specific time interval. As a consequence, no input registers and switches are required. Since this decimation filter is working with a single-bit output bit-stream, the required multiplication function can be simply done by using interlaying multiplexers (MUXs). By interlaying different levels of MUXs along with the navigation of the input bit stream we can easily emulate the multiplication operation. The implementation in a Xilinx Spartan3 FPGA demonstrates the feasibility and hardware efficiency of our solution . The proposed new filter architecture can be readily applicable to any Sigma-Delta (ΣΔ) ADC with a single-bit output stream and it requires a reduced number of adders and registers when compared with the state-of-the-art approaches.
Źródło:
International Journal of Microelectronics and Computer Science; 2012, 3, 4; 152-158
2080-8755
2353-9607
Pojawia się w:
International Journal of Microelectronics and Computer Science
Dostawca treści:
Biblioteka Nauki
Artykuł
    Wyświetlanie 1-2 z 2

    Ta witryna wykorzystuje pliki cookies do przechowywania informacji na Twoim komputerze. Pliki cookies stosujemy w celu świadczenia usług na najwyższym poziomie, w tym w sposób dostosowany do indywidualnych potrzeb. Korzystanie z witryny bez zmiany ustawień dotyczących cookies oznacza, że będą one zamieszczane w Twoim komputerze. W każdym momencie możesz dokonać zmiany ustawień dotyczących cookies